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Tipo da ReferênciaConference Proceedings
Identificador8JMKD3MGP5W34M/3HE6FKU
Repositóriosid.inpe.br/mtc-m21b/2014/11.19.00.01.20
Metadadossid.inpe.br/mtc-m21b/2014/11.19.00.01.21
Sitemtc-m21b.sid.inpe.br
DOI10.1109/LASCAS.2014.6820286
Rótuloscopus 2014-11 MendesCuVaBoCaLiBa:2014:SpMuSB
ISBN9781479925070
Código do Detentorisadg {BR SPINPE} ibi 8JMKD3MGPCW/3DT298S
Chave de CitaçãoMendesCuVaBoCaLiSo:2014:SpMuSB
Autor1 Mendes, C. C. A.
2 Cunha, G. C. L.
3 Vasilevski, M.
4 Bourguet, V.
5 Catunda, S. Y.
6 Lima, R. N.
7 Souza, Márcia Barros de
Identificador de Curriculo1
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7 8JMKD3MGP5W/3C9JHPC
Grupo1
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7 CRN-CCR-INPE-MCTI-GOV-BR
Afiliação1 Department of Electrical Engineering, UFRN, aor3 Natal, RN, Brazil; National Institute for Space Research, INPE-CRN, Natal, RN, Brazil
2 Department of Electrical Engineering, UFRN, aor3 Natal, RN, Brazil; National Institute for Space Research, INPE-CRN, Natal, RN, Brazil
3 Department of Electrical Engineering, UFRN, aor3 Natal, RN, Brazil; National Institute for Space Research, INPE-CRN, Natal, RN, Brazil
4 Department of Electrical Engineering, UFRN, aor3 Natal, RN, Brazil
5 Department of Electrical Engineering, UFRN, aor3 Natal, RN, Brazil
6 Department of Electrical Engineering, UFBA, Salvador, BA, Brazil
7 Instituto Nacional de Pesquisas Espaciais (INPE)
TítuloSpecifications for a multi-standard SBCD/ARGOS-3 integrated UHF satellite receiver
Nome do EventoLatin American Symposium on Circuits and Systems (LASCAS), 5
Ano2014
Título do LivroProceedings
Datafeb. 25–28, 2013
Cidade da EditoraSantiago
Editora (Publisher)IEEE Computer Society
Localização do EventoSantiago
Palavras-ChaveCMOS integrated circuits, Low noise amplifiers, Phase locked loops, Specifications, UHF devices, ARGOS-3, Front-end design, Low intermediate frequency architecture, Multi-standard, Passive mixers, Satellite receivers, SBCD, UHF receivers, Ultrahigh frequency amplifiers.
ResumoThe specifications for the front-end design of a SBCD/ARGOS-3 integrated UHF receiver in a 0.13 ¼m star-dard CMOS process are derived. A low intermediate frequency architecture is presented, in which a 3-stage low-noise amplifier, a passive mixer and a phase-locked loop based frequency synthesizer are employed for achieving the resulting specs. © 2014 IEEE.
Idiomaen
Tipo SecundárioPRE CI
AreaETES
Nota TerciáriaTrabalho não Vinculado à Tese/Dissertação
Tamanho241 KiB
Número de Arquivos1
Última Atualização2015:01.05.20.06.33 sid.inpe.br/mtc-m21b/2013/09.26.14.25.20 administrator
Última Atualização dos Metadados2018:06.04.03.04.34 sid.inpe.br/mtc-m21b/2013/09.26.14.25.20 administrator {D 2014}
Estágio do Documentoconcluido
É a matriz ou uma cópia?é a matriz
Espelhoiconet.com.br/banon/2006/11.26.21.31
Endereço de e-Mailmarcelo.pazos@inpe.br
e-Mail (login)banon
Grupo de Usuáriosadministrator
banon
marcelo.pazos@inpe.br
Grupo de Leitoresadministrator
banon
Visibilidadeshown
Transferível1
Acervo Hospedeirosid.inpe.br/mtc-m21b/2013/09.26.14.25.20
Tipo do ConteudoExternal Contribution
Estágio do Documentonot transferred
Tipo de Versãopublisher
Permissão de Leituraallow from all
Unidades Imediatamente Superiores8JMKD3MGPCW/3EUAPES
Conteúdo da Pasta sourcenão têm arquivos
Conteúdo da Pasta agreementnão têm arquivos
Histórico2018-06-04 03:04:34 :: administrator -> banon :: 2014
Campos Vaziosaccessionnumber archivingpolicy archivist callnumber copyholder copyright creatorhistory descriptionlevel dissemination edition editor electronicmailaddress format issn lineage mark nextedition notes numberofvolumes orcid organization pages parameterlist parentrepositories previousedition previouslowerunit progress project rightsholder secondarydate secondarykey secondarymark serieseditor session shorttitle sponsor subject targetfile tertiarytype type url volume
Data de Acesso23 out. 2020
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