1. Identity statement | |
Reference Type | Thesis or Dissertation (Thesis) |
Site | marte3.sid.inpe.br |
Holder Code | isadg {BR SPINPE} ibi 8JMKD3MGPCW/3DT298S |
Identifier | 8JMKD3MGPAW/PUCQNB |
Repository | sid.inpe.br/iris@1905/2005/07.28.23.25.30 (restricted access) |
Last Update | 2017:10.31.18.23.39 (UTC) viveca@sid.inpe.br |
Metadata Repository | sid.inpe.br/iris@1905/2005/07.28.23.25.38 |
Metadata Last Update | 2018:06.06.04.13.51 (UTC) administrator |
Secondary Key | INPE-5459-TAE/017 |
Label | 6539 |
Citation Key | Santos:1992:PrImAr |
Title | Projeto e implementacao de uma arquitetura paralela para aplicacoes em filtragem e controle |
Alternate Title | x |
Year | 1992 |
Secondary Date | 19930416 |
Date | 1992 |
Access Date | 2024, Apr. 28 |
Thesis Type | Dissertação de Mestrado |
Secondary Type | TAE |
Number of Pages | 113 |
Number of Files | 1 |
Size | 1844 KiB |
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2. Context | |
Author | Santos, Walter Abrahao dos |
e-Mail Address | viveca@sid.inpe.br |
University | ITA |
City | Sao Jose dos Campos |
History (UTC) | 2008-09-10 20:02:09 :: administrator -> jefferson :: 2009-06-02 19:03:49 :: jefferson -> banon :: 2009-06-02 19:29:42 :: banon -> administrator :: 2009-07-08 21:01:37 :: administrator -> jefferson :: 2009-07-09 15:51:40 :: jefferson -> administrator :: 2010-04-30 15:24:43 :: administrator -> jefferson :: 2010-04-30 15:33:29 :: jefferson -> administrator :: 2012-10-31 01:31:29 :: administrator -> viveca@sid.inpe.br :: 1992 2017-10-31 18:23:39 :: viveca@sid.inpe.br -> administrator :: 1992 2018-06-06 04:13:51 :: administrator -> viveca@sid.inpe.br :: 1992 |
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3. Content and structure | |
Is the master or a copy? | is the master |
Content Stage | completed |
Transferable | 1 |
Content Type | External Contribution |
Keywords | PROCESSAMENTO DIGITAL DE IMAGENS ARQUITETURA (COMPUTACAO) PROCEDIMENTO PARALELO |
Abstract | Este trabalho apresenta o projeto, a implementacao e a aplicacao em tempo real de uma arquitetura multiprocessadora de baixo custo e com alta capacidade para processamento numerico. Dois processadores digitais de sinais TMS320C30 sao empregados para processamento numerico intensivo, e um microcontrolador PCB80C552 faz a interface da arquitetura com sistemas analogicos/digitais. Um microcomputador IBM-PC e empregado como hospedeiro, plataforma de desenvolvimento de aplicativos e interface eficiente com o usuario. Os processadores se comunicam via memoria SRAM de duplo acesso atraves de um protocolo dirigido por interrupcoes. Alem de flexivel, a arquitetura pode ser expandida para implementacao em hipercubo. Aplicacoes em tempo real de filtragem e controle adaptativo sao apresentados e discutidas. Uma metodologia baseada em heuristica para a paralelizacao de algoritmos seriais em equivalentes paralelos mapeados na arquitetura e proposta. |
Area | ETES |
doc Directory Content | access |
source Directory Content | lista_resumo.php?num_tese=000551325 | 02/06/2009 16:03 | 6.7 KiB | |
agreement Directory Content | there are no files |
|
4. Conditions of access and use | |
Language | pt |
Target File | 5459.pdf |
User Group | administrator jefferson |
Visibility | shown |
Copy Holder | SID/SCD |
Read Permission | deny from all |
Update Permission | not transferred |
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5. Allied materials | |
URL (untrusted data) | http://www.bd.bibl.ita.br/tesesdigitais/lista_resumo.php?num_tese=000551325 |
Host Collection | sid.inpe.br/banon/2001/04.03.15.36 |
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6. Notes | |
Empty Fields | academicdepartment affiliation archivingpolicy archivist callnumber committee copyright course creatorhistory descriptionlevel dissemination doi electronicmailaddress format group isbn issn lineage mark mirrorrepository nextedition nexthigherunit notes number orcid parameterlist parentrepositories previousedition previouslowerunit progress readergroup resumeid rightsholder schedulinginformation secondarymark session shorttitle sponsor subject tertiarymark tertiarytype versiontype |
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7. Description control | |
e-Mail (login) | viveca@sid.inpe.br |
update | |
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